FPGA用ROM輸出正弦波

来源:https://www.cnblogs.com/Lclone/archive/2023/01/30/17076204.html
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1、創建工程後點擊IP Catalog 2、在搜索欄搜索ROM,並選擇Block Memory Generator 3、在彈出來的界面中選擇單口ROM 4、然後修改位寬和深度(這裡根據我的需求設置為8位寬,4096深度);並把使能埠取消;勾上Core Output Register,使數據延遲一個 ...


1、創建工程後點擊IP Catalog
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2、在搜索欄搜索ROM,並選擇Block Memory Generator
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3、在彈出來的界面中選擇單口ROM
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4、然後修改位寬和深度(這裡根據我的需求設置為8位寬,4096深度);並把使能埠取消;勾上Core Output Register,使數據延遲一個時鐘周期輸出;由於有primitives Output Register的原因總的會延遲兩拍輸出。。
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5、然後打開小梅哥的Mif精靈,選擇Xilinx、位寬為8為,深度為4096、最大值為256然後點擊OK後在軟體所在的文件夾生成coe文件。
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6、將coe文件放在找得到的地方,並來到Other Options,勾上Load Init File,點擊Browse找到coe文件。第4步為將未用到的存儲單元填充一個指定的數字,這裡填充的數字為0。
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7、修改名字後點擊OK生成該ROM核
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8、展開IP核,點擊verilog文件,可以看到埠模塊。(如果生成的是HDL文件,這裡建議去模擬文件夾裡面展開,展開的是verilog文件)
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9、編寫tb文件,例化IP核,進行模擬。
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10、模擬結果
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